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Altium专家:从错误中学习,不再仿真

更新时间:2022-09-30

本文摘要:前几天,我和一位专门设计硬核FPGA的设计师谈了我开发系统芯片的方式。因为我提到了FPGA,他回答了我对模拟器的感觉。 当我告诉他我近三年没有依靠模拟器时,他吓了一跳。真让人惊讶。(威廉莎士比亚,泰姆派斯特,希望如此)这与许多其他FPGA设计师的对话非常相似,以提高设计抽象性。就像软件开发人员依赖调试器和代码模拟器查询错误和检查功能一样,FPGA设计人员对使用模拟器执行这些任务有一定的习惯。

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前几天,我和一位专门设计硬核FPGA的设计师谈了我开发系统芯片的方式。因为我提到了FPGA,他回答了我对模拟器的感觉。

当我告诉他我近三年没有依靠模拟器时,他吓了一跳。真让人惊讶。(威廉莎士比亚,泰姆派斯特,希望如此)这与许多其他FPGA设计师的对话非常相似,以提高设计抽象性。就像软件开发人员依赖调试器和代码模拟器查询错误和检查功能一样,FPGA设计人员对使用模拟器执行这些任务有一定的习惯。

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模拟器可以为FPGA设计师提供开发简单IP所需的控制手段和可见性,然后围绕更好的建模工具组织设计师设计过程。不开展建模,专门从事设计的观念几乎是违反惯例的。

与此相比,这是电路板设计者使用的方法。所谓电路板设计者,是指专门将现成的零部件收集到印刷电路板上,生产新型电子产品的人。假设这些组件符合产品数据的规范,电路板设计者会将组件视为黑匣子,并将重点放在周围组件之间的相互通信上,而不是组件内部。系统的总体建模并不多见。

无视代码测试和/或建模源代码,展开示例设计和实时操作。就像电路板设计者一样,在门/门电路级别对整个系统建模一样,FPGA设计者不对系统建模的情况也同样难以理解。随着电路板设计师越来越多地用于FPGA和现成IP,有哪些适合增加设计和放慢研发速度的开发方法?他们不应该建模还是建模?FPGA建模最适合开发自定义IP的设计师。

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但是,一旦IP被检查,这些IP下游使用的设计师重复这件事就没有什么价值了。忽视(阿尔伯特爱因斯坦,Northern Exposure(美国电视),他们应该采取类似电路板设计师的战略。也就是说,展开实况样品设计。

当然,要使它成为可能,必须有一个适当的持续执行平台。对很多传统FPGA设计师来说,对这种方式的主张仍然难以忍受。但是,随着设计从抽象水平到系统水平的大幅减少,在建模的基础研究开发方面,该方法仍然更好。

(威廉莎士比亚、温斯顿、抽象化、抽象化、抽象化、抽象化、抽象化、抽象化)使用新一代设计工具的电路板设计者本质上被嘲笑为要比现有用户更好地利用FPGA。


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